MC9S12XS128多功能开发板学习笔记

最新更新时间:2021-07-30来源: eefocus关键字:MC9S12XS128  开发板  学习笔记

#时钟的设置

时钟主要为三个寄存器的设置:

SYNR;

REFDV;

POSTDIV;

使用的公式为:

FVOC=2OSCCLK((SYNR+1)/(REFDV+1))

PLLCLK=FVCO/(2*POSTDIV)

BusClock=PLLCLK/2

在这里插入图片描述

BusClock为总线频率(单片机实际运行频率);

首先默认两个数值

REFDV=1;POSTDIV=0;(POSTDIV为0时, PLLCLK=FVCO);

在这里插入图片描述
在这里插入图片描述

FOSC为外部晶振频率

在这里插入图片描述

根据上图计算出REFCLK的范围确定REFDV的值,例如外部晶振为12MHZ;

我们需要48MHZ的频率,那么REFFRQ=01;REFDV=0x40|0x01;

SYNR=7;


初始化配置

(1)禁止总中断;(disabled interrupt)


(2)寄存器CLKSEL的第七位置0,即CLKSEL_PLLSEL=0。选择时钟源为外部晶振OSCCLK,在PLL程序执行前,内部总线频率为OSCCLK/2。


(3)禁止锁相环PLL,即PLLCTL_PLLON=0


(4) 根据想要的时钟频率设置SYNR和REFDV和POSTDIV三个寄存器。


(5)打开PLL,即PLLCTL_PLLON=1


(6)查看CRGFLG_LOCK位,确定PLL是否稳定


(7)PLLCLK稳定后,允许锁相环时钟源PLLCLK为系统提供时钟,即CLKSEL_PLLSEL=1。


(8)开总中断


锁相环设置完成。


3.2锁相环设置实例程序


void

busclock_init(void) //40|03,80|01 32Mhz //c0|07,80|01 64MHz //c0|09,80|01 80Mhz


{

DISABLE_INTERRUPTS;

//禁止总中断


CLKSEL_PLLSEL=0; //选择时钟源为外部晶振OSCCLK,在PLL程序执行前,内部总


//频率为OSCCLK/2


//clksel.7(PLLSEL选择位)决定内部总线时钟来源//=0,BusClock=OSCCLK/2; =1,BusClock=PLLCLK/2


PLLCTL_PLLON=0; //PLLCTL.6(pllon)设为0;先关闭PLL


//根据需要的时钟频率设置SYNR和REFDV寄存器 


BusClock=PLLCLK/2;


//计算公式:


FVOC=2OSCCLK((SYNR+1)/(REFDV+1))


//         


PLLCLK=FVCO/(2*POSTDIV)


//         


BusClock=PLLCLK/2


//SYNR(.7.6)  32MHZ

//SYNR(.7.6)  48MHZ

//SYNR(.7.6)

80MHZ

//SYNR(.7.6)  120MHZ

C


SYNR=0xc0 | 0x09;


//计算公式


FREF=OSCCLK/(REDIV*2)


//REFDV(.7.6)  1MHZ

//REFDV(.7.6)  2MHZ

//REFDV(.7.6)  6MHZ

//REFDV(.7.6)  12MHZ

C


REFDV=0x80 | 0x01;


//后分配寄存器PLLCLK=FVCO/(2*POSTDIV) 如果POSTDIV=0x00,PLLCLK=FVCO


POSTDIV=0x00;


PLLCTL_PLLON=1; //PLLCTL.6(pllon)设为1;打开PLL


_asm(nop);


_asm(nop);


while(CRGFLG_LOCK0); //根据CRGFLG寄存器的LOCK位,确定PLL是否稳定

LOCK1 稳定,==0 不稳定


CLKSEL_PLLSEL =1; //选择PLL作为时钟源


}

关键字:MC9S12XS128  开发板  学习笔记 编辑:什么鱼 引用地址:http://news.eeworld.com.cn/mcu/ic543354.html

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