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第96期国际名家讲堂邀请您来:共同探讨用于无线收发机的锁相频率综合与调制技术!

2019-11-07
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科技活动报名平台“活动芯球”,为大家推荐参加“第96期国际名家讲堂:用于无线收发机的锁相频率综合与调制技术”,并由今日芯闻提供媒体宣传支持。

讲堂时间&地点


(英文授课,需注册费,详见下文)

时间:2019年11月18-19日(周一、周二)

地点:南京市江北新区


#名家介绍#

Woogeun Rhee(李宇根)

清华大学微电子与纳电子学系教授

李宇根教授于1991年本科毕业于首尔国立大学电子工程系,1993年获加州大学洛杉矶分校电气工程硕士学位,并于2001年在伊利诺伊大学厄本那香槟分校取得电气与计算机工程博士学位。

从1997至2001年,李宇根教授服务于位于美国加州纽波特海滩的科胜讯系统公司(Conexant Systems),担任主要工程师,主要负责了低功耗低成本分数型频率合成器的设计与研发。2001年至2006年间,他加入了IBM 托马斯•J•沃森研发中心(Yorktown Heights,纽约),针对高速输入输出串行接口时钟进行研究,包括低相位抖动的锁相环路、时钟与数据恢复电路以及片上可测性管理单元。在2006年8月,其加入了清华大学微电子与纳电子学系并于2011年9月获教授职称。目前,李宇根教授主要领导的研究方向包括:用于有线与无线传输系统的低功耗片上时钟/频率生成器。他目前拥有相关领域的23项美国专利。

李宇根博士目前是IEEE固态电路学会杰出讲师(2016-2017),并担任IEEE JOURNAL OF SOLID-STATE CIRCUITS的副主编。他曾担任IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS PART-II: EXPRESS BRIEFS (2008-2009)和IEEE JOURNAL OF SOLID-STATE CIRCUITS 2012年11月和2013年11月特刊的客座编辑。此外,他曾数次担任IEEE会议成员,包括ISSCC(2012-2016),CICC和A-SSCC。


讲堂安排


【课程摘要】

A phase-locked loop is a key building block in wireline and wireless systems. In the wireline systems, low-jitter clock generation and versatile clock-and-data recovery circuits are critical in high data rate I/O links. In the wireless systems, the fractional-N PLL based synthesizer plays a critical role in modern transceivers not only as a local oscillator but also as a phase modulator with direct digital modulation. However, the traditional PLL in advanced CMOS technology suffers from poor scalability, loop parameter variability and leakage current problems. Accordingly, diversified PLL architectures and circuit techniques have been recently proposed in consideration of performance, power and cost, thus making it more difficult for circuit designers to choose the right design solution than ever. This lecture gives some insight into PLL basics tailored for circuit designers. Then, system perspectives and practical circuit design aspects will be presented. Furthermore, various PLL architectures and design challenges will be discussed.

锁相环是有线和无线收发系统中的关键模块。比如在有线收发系统中,低抖动的时钟产生电路与通用的时钟数据恢复电路在高数据速率I/O链路中至关重要。而在当今的无线收发系统中,基于分数分频锁相环的频率合成器发挥着至关重要的作用,其不仅可用于本振信号产生,亦可在直接数字调制中扮演相位调制器的角色。然而,在先进的CMOS工艺中设计传统架构的锁相环时,面临着可移植性差、环路参数不确定性及泄漏电流等问题。因此,基于提升性能、降低功耗和成本等方面的考虑,近年来涌现出了多种新型的锁相环架构和电路,而这又进一步增加了电路设计者选取正确设计方案的难度。本讲堂首先为电路设计人员定制了的必要锁相环基础知识,进而分别介绍系统层面和实际电路层面的设计考虑;此外,课程还将讨论各类新颖的锁相环架构以及当前所面临的最新设计挑战。


【课程定位】

This lecture gives insights into phase-locked loops with system perspectives and circuit design aspects for various applications. From this lecture, the audiences expect to learn followings:

此次PLL课程从基础知识入门,循序渐进至各类先进架构;课程内容涵盖系统层面及实际电路层面的各种设计考量,是为集成电路设计人员量身定制的一次课程。


【课程大纲】

This lecture gives insights into phase-locked loops with system perspectives and circuit design aspects for various applications. From this lecture, the audiences expect to learn followings:

I. Overview of Frequency Generation

II. Phase-Lock Basics

   1. Concept of phase-lock technique

   2. PLL linear model and loop dynamics

   3. Transient response and acquisition

III. PLL Design

   1. System design perspectives

       1.1. Phase noise and jitter

       1.2. Spur generation

       1.3. Settling time

       1.4. Bandwidth optimization

   2. Circuit design aspects

       2.1. Phase detector

       2.2. Charge pump

       2.3. Frequency divider

       2.4. Voltage-controlled oscillator (VCO)

IV. Advanced PLLs

   1. Digital-intensive PLLs

   2. Fractional-N PLLs

V. PLL based modulation for modern transceiver systems

   1. PLL based modulation basics

   2. Advanced modulation methods


本课程将从系统的角度和电路设计的角度对锁相环的各种应用进行深入的探讨。从本次讲堂中,学员将会了解以下内容:

(一)频率产生概述

(二)锁相基础知识

1. 锁相技术的概念

2. 锁相环的线性化模型和环路的动态行为

3. 环路的瞬态响应与频率捕获

(三)锁相环设计

1. 系统设计的角度

1.1相位噪声和抖动

1.2 杂散的产生机理

1.3 环路的建立时间

1.4 环路带宽优化

2. 电路设计方面

2.1 鉴相器

2.2 电荷泵

2.3 分频器

2.4 压控振荡器

(四)先进的锁相环技术

1. 深度数字化的锁相环

2. 分数分频锁相环

(五)基于锁相环的现代收发系统调制

1. 基于锁相环的调制基础

2. 先进的调制方式


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组织单位

主办单位

工业和信息化部人才交流中心

南京市江北新区管理委员会

承办单位

IC智慧谷

协办单位

南京江北新区产业技术研创园

南京软件园

南京集成电路产业服务中心

南京江北新区人力资源服务产业园

支持单位

SEMI China 

支持媒体

中国半导体论坛、EETOP、芯师爷、活动芯球、

半导体行业联盟、与非网、电子创新网、

IC咖啡、微友助手


“芯动力”人才计划是工业和信息化部人才交流中心组织开展的、服务国家集成电路产业发展的人才专项,通过整合国内外优质智力资源,搭建园区、企业、人才等行业要素广泛参与、资源共享的交流平台,构建充满活力和富含价值的集成电路产业人文生态环境。

IC智慧谷

“芯动力”人才计划在部分城市设立“IC智慧谷”,由中心与地方政府共同运营,目的是提升城市集成电路产业品牌形象,实现集成电路产业人才和项目集聚,为本地区集成电路人才搭建学习、交流、合作、创业平台。


联系人:汪晨、周静梅

电   话: 025-58262171、025-58262193(010-68207851)

E-mail:icplatform@miitec.cn  

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