欧洲处理器计划第二期公布,选择了Arm与RISC-V

最新更新时间:2022-01-09来源: EEWORLD关键字:欧洲处理器计划  EPI 手机看文章 扫描二维码
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欧洲处理器计划的 Rhea 芯片包含 29 个 RISC-V 内核,第二阶段将于 1 月开始


欧洲处理器计划 (EPI) 已成功完成其第一个为期三年的阶段,为超级计算机和汽车提供多核芯片设计。


该项目突出了 Rhea 通用处理器从 ARM 到 RISC-V 的转变、RISC-V 加速器概念验证和用于汽车应用的嵌入式高性能微控制器。


该项目有来自10个欧洲国家的28个合作伙伴,旨在使欧盟在高性能计算(HPC)芯片技术实现独立。


第一阶段 SGA1 的成功完成,为该项目的第二部分铺平了道路,第二部分项目将于 2022 年 1 月启动。


通用处理器 (GPP) 的初始设计称为 Rhea,包含72 个 ARM Zeus 处理器。


法国超级计算机制造商 Atos 是通用处理器 (GPP) 的主要合作伙伴,与 SiPearl 合作。他们定义了 Rhea 的架构规范,它现在有 29 个内核,使用 RISC-V 开放指令集架构,并且目前完成了RTL仿真,而不是在硅上实现。该设计旨在用于 2023 年的超级计算机设计。


该项目表示:“凭借 29 个 RISC-V 内核,SiPearl 用于设计 Rhea 的 Arm Neoverse V1 架构将为 HPC 应用程序提供有效、可扩展和可定制的解决方案。架构决策是遵循协同设计方法并通过分析高级IP的性能而做出的。 SiPearl 还优化了可扩展的片上网络 (NoC),以实现内核、加速器、输入/输出 (IO) 和共享内存资源之间的高频、高带宽数据传输。”


“我们为利用欧洲大学和行业领导者独家构建和部署的尖端技术和 IP 成功设计强大的 GPP 感到自豪。我们有信心,我们很快就会证明这个 GPP 在实现欧洲百亿亿级计算机器方面的重要作用,这是世界期待的 HPC 领域的下一个突破。”Atos 的 Stream 负责人 Emmanuel Ego 说。


“随着 Rhea 处理器的发布,我们都将为确保欧洲在 HPC 应用(例如个性化医疗、气候建模和能源管理)方面的自主可控做出贡献。”SiPearl 的创始人兼首席执行官 Philippe Notton 说。


就 GPP 性能而言,内存控制器是最关键的 IP 之一。为了帮助评估架构选择,CEA 开发了一个带有特定仪器的完整仿真平台,用于分析驱动高带宽 HBM2E 存储器的控制器效率。由于对所有内存命令和数据进行解码和跟踪,该平台允许对内存设备接口进行有效分析。 HBM2E 子系统使用针对不同模型的多个随机数据和指令模式进行仿真,并涉及所有控制器功能以保持 HBM2E 效率。


该芯片还设计了许多最先进的嵌入式安全功能和关键技术。其中包括由 ProvenRun 开发的独立安全管理系统 (SMS) 安全 IP,为 HPC 和边缘处理器提供高级、通用标准认证的主权安全 IP。


比萨大学贡献了一组加密 IP,称为“Crypto Tile”,由 SiPearl 集成到 Rhea GPP 中。这为硬件安全模块提供了针对高端对称(具有九种密码模式的 AES)、非对称(ECC、ECDSA、ECIES、ECDH)和散列 (SHA2/SHA3) 加密的完整安全服务,提供了几个数量级的吞吐量增加并且与软件解决方案相比降低了能源成本。


Crypto Tile 还包括安全密钥存储和安全 IP 配置、侧信道攻击保护、片上真随机数生成 (TRNG)、Linux 内核驱动程序支持、最大安全级别的极端密钥长度,得益于面向 DMA 和 Arm 或 RISC-V 可编程内核的基于 AXI4 的接口,从而提高了加密吞吐量。此外还支持量子加密。


欧洲处理器加速器 (EPAC) 测试芯片概念验证使用开源指令集架构 (ISA) 确保不受专有许可和出口限制的影响,有助于扩展 RISC-V 生态系统并添加到 LLVM 编译器数据库。


EPAC 系统和 FPGA 软件开发工具充分利用 Linux 操作系统,并通过补丁、设备驱动程序和附加功能为社区做出贡献支持流行的开源 HPC 软件包,例如 OpenMP 和 MPI。此外,STX(模板/张量加速器)等硬件的一部分是使用围绕 PULP 平台的许可开源方法开发的。


“EPI 中的加速器流有力地证明了 RISC-V 矢量方法具有改变高性能计算领域的潜力,欧洲设计的架构能够在低能耗预算下提供高性能,”Stream Leader Jesús Labarta 评论道(巴塞罗那超级计算中心)。 “这项工作还体现了欧洲开放科学与合作的传统。欧洲各地的合作伙伴联手创造了任何单一组织都无法单独实现的目标。通过与开源技术和项目合作,EPAC帮助扩展了 RISC-V 生态系统,使这项技术在未来越来越多的应用程序中可行。”


由 BSC 和 UNIZG 设计的 EPAC 矢量处理单元 (VPU) 表明,使用 RISC-V 长矢量架构进行高性能计算是一种可行的方法,在低能耗预算下提供高性能,并且可以将来扩大规模。


矢量单元由 Semidynamics 的矢量专用 Avispado RISC-V 内核和用于节能处理的 Gazzillion Misses 技术驱动。


由苏黎世联邦理工学院和弗劳恩霍夫设计的专用且灵活的基于 RISC-V 的众核模板和张量加速器 (STX),利用模板处理单元为机器学习和模板工作负载提供卓越的能效和可编程性。


同时,由 CEA 设计的可变精度加速器 (VRP) 提高了多物理场仿真等科学高性能计算应用的效率和可靠性。


EPAC 测试芯片还包括由 FORTH 和 CHALMERS 设计的多个分布式共享 L2 缓存和一致性节点 (L2HN),针对矢量处理单元的高带宽要求进行了优化,同时提供了更好的多核可编程性。


所有处理单元和共享的 L2HN 都通过高速 NoC 以模块化方式连接,支持可扩展性。该测试芯片还包括用于高带宽的片外和跨芯片通信的先进 SERDES 技术。NoC 和 SERDES 均由 Extoll 设计。


用于测试 EPAC 测试芯片的 PCB(子板)由 E4 Computer Engineering 设计和开发。


在汽车微控制器的领导者英飞凌的协调下,由于创新的嵌入式高性能计算(eHPC)平台和相关软件开发工具包(SDK)的概念验证,汽车流已经为实现可上路的自动驾驶汽车铺平了道路。该平台与一个缩小的、为汽车量身定做的通用处理器相结合,以一种具有成本效益、经济可行和功能安全的方式满足未来汽车对算力日益增长的需求。


"总的来说,这些成就是合作、协同和团队精神的证明,这也是汽车组研究工作的特点。",组长Knut Hufeld(英飞凌)说。"凭借其对成本效益、安全和认证的汽车解决方案的关注,它可以被看作是欧洲处理器在HPC领域整体发展的一个驱动。"


主要成果在一辆通过道路认证的宝马X5汽车上进行了展示,以证明一个开创性的eHPC微控制器单元(eHPC MCU)的概念,该单元与几个EPI的IP一起集成在一个专门设计的灵活的模块化计算平台(MCP)中。为收集数据和评估涉及自动驾驶参数的测试场景,进行了大量的试驾。


在其他功能中,该平台包括人工智能支持的集成相机和Elektrobit雷达成像分析软件,并为在系统中使用EPI加速器进行了综合准备。这是Stream4的16个合作伙伴之间密切合作的结果,旨在实现其目标,即指定一个合适的eHPC平台,定义其架构并开发必要的软件开发工具包(SDK)。


英飞凌还在其架构和性能能力方面扩展了汽车微控制器,使其能够作为主控器,控制一个或几个加速器,包括安全、保障、回退或冗余,这有助于在系统层面上达到ASIL-D汽车安全等级要求,这是自动驾驶应用所要求的。


该平台是可扩展的,支持未来的汽车版本的EPI通用处理器、基于EPAC RISC-V的加速器以及Kalray用于eHPC的大规模并行处理器阵列(MPPA)加速器可扩展,该加速器是作为Stream 2的一个IP开发的。


测试运行表明,EPI现在拥有适用于自动驾驶的能力,至少可以达到4级。


除了硬件平台外,该流程还包括开发一个完整的软件生态系统,在很大程度上是基于汽车软件专家Elektrobit的软件产品。该领域还包括汽车eHPC平台软件栈,包括用于Auto eHPC MCU的经典汽车开放操作系统架构(AUTOSAR)开发,以及用于HPC GPP和L4Re管理程序(虚拟化)的适应性AUTOSAR开发,这对汽车应用至关重要。


"我为EPI团队在短短三年的合作就取得的杰出成果感到自豪,为欧洲的技术自主铺平了道路。我尤其印象深刻的是,尽管由于可怕的COVID-19造成了前所未有的工作条件,我们还是在有限的预算内按时交付了我们的目标。这为下一阶段的启动及其成功交付欧洲处理器和加速器创造了有利条件,用于EUPEX(EUropean Pilot for Exascale)和TEP(The European Pilot)项目,这是欧洲超大规模系统的前奏。"EPI董事会主席Eric Monchalin(Atos)说。

关键字:欧洲处理器计划  EPI 编辑:冀凯 引用地址:http://news.eeworld.com.cn/qrs/ic559928.html

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