芯片设计解决方案供应商微捷码（Magma®）设计自动化有限公司（纳斯达克代码：LAVA）日前宣布，事件驱动处理器（event-driven processors™）领域领导者XMOS公司采用Talus 1.1 IC实现系统完成了其近期发布的XS1-L1 XCore™的投片。XMOS很早就对Talus 1.1进行了测试，在测试结果显示它带来了XCore处理器设计收敛方面有效改善后才升级使用这款最新版微捷码软件。
“我们在XS1开发项目过程中曾对早期版本的Talus 1.1进行了测试，”XMOS公司工程部副总裁Mark Lippett表示。“其布线算法方面的提高让我们决定采用Talus 1.1 版本进行生产投片。”XS1-L产品系列为嵌入式软件开发商提供了一款高效能、可扩展的多核解决方案，实现了可将接口、DSP和控制功能完全集成在软件中的完整系统。每款XS1-L XCore都包括有一个32位处理器，并且运行速率最高可达400 MIPS。XCore在休眠模式下功耗低于500µW，待机模式下功耗低于20mW，处于工作状态时功率增幅低于450µW/MHz。事件驱动架构结合XMOS编程工具使XCore能够在待机与工作模式间自动切换，在低占空比应用中可节省最高达90%的功耗。XS1-L1是基于65纳米工艺而创建。样品现已面市www.xmos.com。
“如同XMOS公司一样，我们的许多其它客户一直在设计着极为复杂芯片，需要功能强大、速度快捷、质量高且易于使用的芯片设计系统。”微捷码设计实施业务部总经理Premal Buch表示。“Talus 1.1不仅具有命令更少的简化流程，并且还提供了更高的性能、时序收敛和功率优化。XMOS采用Talus 1.1快速实现其设计需求的能力就是微捷码COre技术优势的有效证明。”
Talus COre技术
并发优化布线引擎（Concurrent Optimizing Routing Engine，COre）技术是Talus 1.1版产品改善功能的核心。在先进的工艺图形下，复杂的电阻效应、增大的通孔电阻与串扰因素会造成布局的门极电路与最终布线间巨大的时序差异。Talus COre 主要致力于在布线期间增量应用全范围的时序优化；从拓扑结构产生到层分配、轨道分配以及设计规则检查（DRC）违规清理等布线算法的方方面面均具有时序和串扰意识，这就使得设计的收敛速度更快，同时也杜绝了布线后时序意外事件的发生；通过与Talus基于标准延迟格式（SDF）的优化功能结合使用，它无需手工工程变更单（ECO）即可实现时序收敛。
关键字：XMOS Magma Talus
编辑：冀凯 引用地址：XMOS采用微捷码Talus 1.1提高性能
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